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Hardware-Beschreibungssprache VHDL (VHDL-D)2.5 ECTS (Prüfungsordnungsmodul: Hardware-Beschreibungssprache VHDL)
Modulverantwortliche/r: Jürgen Frickel Lehrende:
Jürgen Frickel, []
Startsemester: |
WS 2012/2013 | Dauer: |
1 Semester |
Präsenzzeit: |
30 Std. | Eigenstudium: |
45 Std. | Sprache: |
Deutsch |
Lehrveranstaltungen:
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Hardware-Beschreibungssprache VHDL
(Vorlesung mit Übung, 2 SWS, Jürgen Frickel, Do, 12:15 - 13:45, S1 LIKE, P1 LIKE; Do, 10:15 - 11:45, P1 LIKE; LIKE, Am Wolfsmantel 33, Tennenlohe (3. OG im FhG-Gebäude); zusätzliche Übungen Do., 10:15-11:45 Uhr nur am 15.11., 29.11., 13.12., 20.12. und 24.01.13.)
Inhalt:
Betreuter Multimedia-Kurs über die Syntax und die Anwendung der Hardware-Beschreibungssprache VHDL
(Very High Speed Integrated Circuit Hardware Description Language) nach dem Sprachstandard IEEE 1076-1987 und 1076-1993
Konzepte und Konstrukte der Sprache VHDL
Beschreibung auf Verhaltensebene und RT-Ebene
Simulation und Synthese auf der Gatterlogik-Ebene
Verwendung professioneller Software-Tools
Vorlesung mit integrierten Übungsbeispielen
Übungs-Betreuung in deutsch oder englisch
Kursmaterial englisch-sprachig
Zielgruppe sind Hörer aller Fachrichtungen, die sich mit dem Entwurf und der Simulation digitaler Systeme und Schaltungen beschäftigen wollen.
Bemerkung:
Anmeldung über Mein Campus
Weitere Informationen:
www: http://www.like.eei.uni-erlangen.de
Studien-/Prüfungsleistungen:
Hardware-Beschreibungssprache VHDL_ (Prüfungsnummer: 67501)
- Prüfungsleistung, Klausur, Dauer (in Minuten): 90, benotet
- Anteil an der Berechnung der Modulnote: 100.0 %
- Erstablegung: WS 2012/2013, 1. Wdh.: SS 2013, 2. Wdh.: WS 2013/2014
1. Prüfer: | Albert Heuberger |
- Termin: 22.07.2013, 08:00 Uhr, Ort: H 10 TechF
Termin: 10.02.2014, 10:30 Uhr, Ort: K 1 TechF
Termin: 14.07.2014, 08:00 Uhr, Ort: H 10 TechF
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