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Chair of Computer Science 3 (Hardware Architectures)
Abgeschlossene Examensarbeiten
Laufende Examensarbeiten
Offene Examensarbeiten
Anwendung einer DSE für den Architekturentwurf von Prozessoren für unterschiedliche Videocodecs
Auswirkung ICache / DCache für verschiedene Video Codecs
DL Beschleuniger mit ternären Datenpfaden
Einheitlicher Adressraum für Near-Memory-Beschleuniger
GPU auf FPGA
High-Level-Synthesis für HSA
Implementierung einer Load/Store-Queue für ReRAM-basierte Registerfiles
Implementierung eines Benchmarking-Frameworks für Multi- und Many-Core CPUs
Memristor-Registerfile mit Look-Up-Tabellen Ansatz für ternäre CPU
Mixed-Darstellungen für ternäre CPU
NVDLA auf FPGA mit HSA interface
Performance evaluation of the secp256k1 library
Shift für ternäre CPUs
SoftMul und SoftDiv für ternäre CPU
Untersuchung des NEC Aurora TSUBASA Vektorprozessors
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