|
Einführung digitaler ASIC Entwurf mit Laborübung (EDA-LÜ)7.5 ECTS
Modulverantwortliche/r: Marc Reichenbach Lehrende:
Marc Reichenbach, Dietmar Fey
Start semester: |
SS 2013 | Duration: |
1 semester |
Präsenzzeit: |
90 Std. | Eigenstudium: |
135 Std. | Language: |
Deutsch |
Lectures:
-
-
Einführung digitaler ASIC Entwurf
(Vorlesung, 2 SWS, Marc Reichenbach et al.)
-
Laborübung zu Einführung digitaler ASIC Entwurf
(Übung, 2 SWS, Marc Reichenbach, Mon, 10:15 - 11:45, 02.153)
-
Tafelübungen zu Einführung digitaler ASIC Entwurf
(Übung, Marc Reichenbach, Fri, 10:15 - 11:45, 07.150)
Inhalt:
- Einführung in die Welt der integrierten Schaltkreise
Schaltungstechnische Grundlagen
Designflow für integrierte Schaltkreise
Zeitliche Rahmenbedinungen für die Entwicklung
Testbarkeit
Low-Power-Design
Algorithmen von Entwurfswerkzeugen
Verifikation von Schaltungen
Diese Veranstaltung ist sehr Praxis orientiert. Aus diesem Grund wird zusätzlich zur Tafelübung eine Laborübung (2,5 ECTS) angeboten. Es besteht die Möglichkeit einen integrierten Schaltkreis, der im Rahmen der Laborübung entsteht, fertigen zu lassen und anschliessend (in einer weiteren Veranstaltung) zu testen.
Organisatorisches:
Grundlagen der Technischen Informatik
Grundlagen der Rechnerarchitektur und –organisation
Grundlagen der Schaltungstechnik
Weitere Informationen:
www: http://www3.informatik.uni-erlangen.de/Lehre/EDA/WS2011/index.html
Verwendbarkeit des Moduls / Einpassung in den Musterstudienplan: Das Modul ist im Kontext der folgenden Studienfächer/Vertiefungsrichtungen verwendbar:
- Computational Engineering (Rechnergestütztes Ingenieurwesen) (Bachelor of Science)
(Po-Vers. 2010 | Bachelorprüfung | Technische Wahlmodule | Einführung digitaler ASIC Entwurf)
- Computational Engineering (Rechnergestütztes Ingenieurwesen) (Master of Science)
(Po-Vers. 2008 | Masterprüfung | Wahlpflichtbereich Informatik | Einführung digitaler ASIC Entwurf)
- Informatik (Bachelor of Science)
(Po-Vers. 2009s | Wahlpflichtbereich (5. und 6. Semester) | Wahlpflichtmodule | Vertiefungsmodul Rechnerarchitektur)
- Informatik (Bachelor of Science)
(Po-Vers. 2009w | Wahlpflichtbereich (5. und 6. Semester) | Wahlpflichtmodule | Vertiefungsmodul Rechnerarchitektur)
- Informatik (Master of Science)
(Po-Vers. 2010 | Wahlpflichtbereich | Säule der systemorientierten Vertiefungsrichtungen | Vertiefungsmodul Rechnerarchitektur)
Studien-/Prüfungsleistungen:
Einführung digitaler ASIC Entwurf (Vorlesung mit Übung und Laborübungen)
(diese Prüfung gilt nur im Kontext der Studienfächer/Vertiefungsrichtungen [3], [4], [5])
- mehrteilige Prüfung, benotet
- Erstablegung: SS 2013, 1. Wdh.: WS 2013/2014, 2. Wdh.: keine Wiederholung
Einführung digitaler ASIC Entwurf (Vorlesung mit Übung und Laborübungen)
(diese Prüfung gilt nur im Kontext der Studienfächer/Vertiefungsrichtungen [1], [2])
- mündliche Prüfung, Dauer (in Minuten): 30, benotet
- Erstablegung: SS 2013, 1. Wdh.: WS 2013/2014, 2. Wdh.: keine Wiederholung
|
|
|